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[반도체] TSMC 2nm 공정, 예상보다 저렴하지만 ‘단서’가 붙는다

TSMC의 2nm N2 웨이퍼 가격 인상이 예상되고 있다. 이전 보도에서는 애플, 퀄컴, 미디어텍 등 주요 고객들이 이 웨이퍼를 확보하기 위해 최대 50%의 프리미엄을 지불해야 할 것이라고 전했으나, 새로운 정보에 따르면 가격 차이는 10~20% 수준에 그칠 전망이다. 다만, 이는 TSMC가 현재의 3nm 공정 가격을 인상할 계획이기 때문으로 알려졌다. 보도에 따르면 TSMC의 2nm 웨이퍼가 3nm 대비 10~20% 정도만 비싼 이유는, 제조사가 기존 3nm 공정 가격을 올리려 하기 때문이다. 새 기술의 단가 자체는 여전히 웨이퍼당 3만 달러(약 4,100만 원) 수준으로 유지된다. TSMC는 2025년 4분기부터 2nm N2 웨이퍼의 양산을 시작할 예정이며, 퀄컴은 내년 출시될 스냅드래곤 8 엘리트 Gen 6 칩을 위해 빠르게 N2P 공정으로 전환할 계획이다. 업계 전문가들은 이 리소그래피 기반 웨이퍼 한 장당 약 3만 달러에 달할 것으로 보고 있으며, 이는 스마트폰과 태블릿 같은 소비자 전자기기의 가격 상승으로 이어질 수 있다고 분석했다. 관련 기사에 따르면, TSMC는 차세대 칩 생산을 위한 계획을 진행 중이며, 2nm 공정은 내년 애리조나 공장에서도 생산될 예정이고, 1.4nm(A14) 공정은 2028년 대만에서 양산될 예정이다. 결국 고객사들은 이러한 가격 정책에 따를 수밖에 없지만, 표면적으로 보면 2nm과 3nm의 가격 차이는 크지 않다. 그러나 자세히 들여다보면 이야기가 달라진다. Investor의 보도에 따르면 TSMC는 현재 세대의 리소그래피 가격을 인상할 계획이며, 이에 따라 2nm과 3nm의 차이가 10~20% 수준으로 보이는 것뿐이라고 한다. 현재 N3E 노드는 약 2만 5,000달러, N3P 노드는 약 2만 7,000달러로 책정될 것으로 예상되어, 구세대 공정을 이용해 칩을 생산하려는 기업들에게도 재정적 부담이 가중될 전망이다. 앞서 퀄컴과 미디어텍은 각각 스냅드래곤 8 엘리트 Gen 5와 Dimensity 9500을 생산할 때 3nm N3P 공정으로 전환하면서 최대 24%의 추가 비용을 부담한 것으로 알려졌다. 이는 이번 보도 이전에 이미 가격 인상의 영향을 받았음을 시사한다. 결과적으로 이번 조정으로 인해 3nm에서 2nm로의 전환은 예상보다 덜 부담스러워 보일 수 있지만, 웨이퍼당 3만 달러라는 금액이 결코 가벼운 수준은 아니다. 출처 : https://wccftech.com/tsmc-2nm-wafers-to-be-10-to-20-percent-more-expensive-than-3nm/

UK0000000010 2025.10.08

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