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[반도체] 엔비디아 블랙웰, 메이드인 USA 달고 애리조나 TSMC 에서 생산 돌입
“메이드 인 아메리카, 현실이 되다” 엔비디아, 미국 애리조나 TSMC 공장에서 첫 블랙웰 칩 웨이퍼 공개 엔비디아가 자사의 차세대 AI 칩 ‘블랙웰(Blackwell)’을 미국에서 생산하기 시작했다. 젠슨 황 CEO는 미국 애리조나에 위치한 TSMC 공장에서 “첫 블랙웰 칩 웨이퍼가 미국 땅에서 완성됐다”고 발표했다. 그는 이를 “미국 제조 산업의 새로운 전환점”이라고 강조했다. 또한, “미국에서 가장 중요한 칩이, 이제 미국에서 만들어지고 있다.” 는 한마디로 트럼프 정부 이후 주도권을 자시금 미국으로 되찾아 오기 위한 반도체 산업의 재편이 현실화 되었음이 명확해졌다. 사실 트럼프 행정부 출범 이후 본격화된 ‘리쇼어링(reshoring)’, 즉 제조업의 본국 회귀 움직임 속에서 엔비디아의 입지는 절대적이다. 회사는 미국 내 반도체 인프라에 5천억 달러를 투자하겠다고 밝혔고, 이에 따라 폭스콘(Foxconn), 콴타(Quanta) 같은 주요 공급업체들도 미국 내 생산 시설 구축에 나선 바 있다. “이것은 미국의 재산업화 비전이며, 일자리를 창출하고, 무엇보다 세계에서 가장 중요한 제조 산업을 되살리는 일이다.” 젠슨 황은 트럼프 대통령의 정책 기조를 언급하며, 반도체 산업의 중요성을 강조했다. 젠슨 황과 함께 무대에 오른 TSMC 애리조나 CEO 레이 추앙(Ray Chuang)은 “TSMC가 미국에서 블랙웰 웨이퍼 생산을 개시했다는 사실은, 불가능하다고 여겨졌던 목표를 불과 몇 년 만에 현실로 만든 결과”라고 말했다. TSMC 애리조나 공장은 올해 4월부터 블랙웰 생산 라인을 구축하기 시작해, 불과 6개월 만에 첫 웨이퍼를 완성했다. 반도체 제조 과정에서 웨이퍼는 핵심 단계로, 이후 레이어링(layering), 패터닝(patterning), 식각(etching), 다이싱(dicing) 등의 공정을 거쳐 최종 AI 칩으로 완성된다. 이 같은 속도는 여전히 TSMC가 세계에서 가장 정밀한 반도체 제조 기술을 보유하고 있음을 암시한다. TSMC는 애리조나를 앞으로 “2나노, 3나노, 4나노 공정뿐 아니라 A16(1.6nm) 공정까지” 미국 내 생산 거점으로 이끌겠다고 밝혔다. 이는 미국이 대만과 더불어 차세대 반도체 생산의 또 다른 중심지 부상하고 있음을 의미한다. 블랙웰 웨이퍼의 탄생으로 기술 패권의 축이 다시금 미국을 중심으로 빠르게 재편되고 있다. 이것은 현실이다. 출처: WCCFtech / Muhammad Zuhair ** 해외 외신을 읽기 좋게 재구성, 커뮤니티 빌런 18+에만 업데이트 하였습니다.
2025.10.19
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[모바일] 삼성 엑시노스 2600, 5G 모뎀 빠진 가능성 제기
“삼성 엑시노스 2600, 효율 문제로 설계 변경 가능성 있어” 5G 모뎀이 별도 구성된다는 루머 확산 삼성이 차세대 엑시노스 2600(Exynos 2600) 칩셋에서 중요한 설계 변화를 시도하고 있다는 소식이 전해졌다. 관련 업계에 따르면, 엑시노스 2600에는 통합형 5G 모뎀이 포함되지 않을 가능성이 제기됐다. 즉, 칩셋 내부에 내장되는 대신 별도의 모뎀 칩이 스마트폰 메인보드에 탑재된다는 것이다. “사실이라면, 엑시노스 2600은 전력 효율성 측면에서 스냅드래곤 8 엘리트 젠5(Snapdragon 8 Elite Gen 5)와 디멘시티 9500(Dimensity 9500)에 비해 불리한 위치에 놓이게 된다.” 삼성은 9월 말부터 자사 최초의 2나노 게이트 올 어라운드(2nm GAA) 공정 기반 칩셋 엑시노스 2600의 양산을 시작한 것으로 알려졌다. 그러나 수개월간 이어진 개발 관련 소식 속에서도, 칩셋과 짝을 이룰 5G 모뎀에 대한 구체적인 언급은 없다. 커뮤니티에 등장한 주장에 따르면 미코(Meeco) ‘Beomkwi’라는 사용자는 “엑시노스 2600에는 내장 모뎀이 존재하지 않으며, 별도의 베이스밴드 칩이 탑재될 것”이라고 주장했다. 하지만 스냅드래곤 8 엘리트 젠5와 미디어텍 디멘시티 9500도, 칩셋 다이(die)에 모뎀을 통합해 전력 효율성을 높였다고 발표한 바 있다. 따라서, 엑시노스 2600에 모뎀을 별도로 추가해야 할 경우, 불리할 수 있다. “별도 5G 모뎀은 배터리 소모를 증가시키고, 메인보드 공간을 더 차지하며, 결과적으로 삼성의 2나노 공정이 가져올 전력 효율 개선 효과를 상쇄시킨다.”는 문제 때문이다. 삼성 2nm GAA 공정은 기존 3nm GAA 대비 성능을 최대 12%, 전력 소모를 최대 25% 줄일 수 있다고 알려졌지만, 모뎀의 분리 설계는 기술적 이점을 온전히 살리지 못하게 만든다. 이는 곧 엑시노스 2600이 경쟁 칩셋에 비해 배터리 효율 면에서 불리해질 수 있음을 의미한다. 현재 애플 역시 아이폰에 퀄컴의 5G 모뎀을 별도로 탑재하고 있지만, 최근 아이폰 16e와 아이폰 에어(Air) 모델에서 자체 베이스밴드 칩(C1, C2)을 도입하며 방향 전환을 모색하고 있다. 이와 같은 변화는 향후 애플이 통합형 모뎀 아키텍처로 이동할 가능성을 시사한다. 루머는 아직 공식적으로 확인된 내용은 아니다. 그러나 “삼성이 경쟁력을 유지하려면 엑시노스 2600에 통합형 5G 모뎀을 포함시켜야 한다”는 의견에 힘이 실리고 있다. 삼성 엑시노스 2600은 내년 출시 예정으로, 스냅드래곤 8 엘리트 젠5, 디멘시티 9500, 애플 A19 프로 등과 직접 경쟁할 전망이다. 물론 루머가 현실이 되면 경쟁 구도에서 우위로 오를 가능성은 제로에 가깝다. 출처: WCCFtech / Omar Sohail ** 해외 외신을 읽기 좋게 재구성, 커뮤니티 빌런 18+에만 업데이트 하였습니다.
2025.10.19
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[반도체] TSMC 2nm 공정, 예상보다 저렴하지만 ‘단서’가 붙는다
TSMC의 2nm N2 웨이퍼 가격 인상이 예상되고 있다. 이전 보도에서는 애플, 퀄컴, 미디어텍 등 주요 고객들이 이 웨이퍼를 확보하기 위해 최대 50%의 프리미엄을 지불해야 할 것이라고 전했으나, 새로운 정보에 따르면 가격 차이는 10~20% 수준에 그칠 전망이다. 다만, 이는 TSMC가 현재의 3nm 공정 가격을 인상할 계획이기 때문으로 알려졌다. 보도에 따르면 TSMC의 2nm 웨이퍼가 3nm 대비 10~20% 정도만 비싼 이유는, 제조사가 기존 3nm 공정 가격을 올리려 하기 때문이다. 새 기술의 단가 자체는 여전히 웨이퍼당 3만 달러(약 4,100만 원) 수준으로 유지된다. TSMC는 2025년 4분기부터 2nm N2 웨이퍼의 양산을 시작할 예정이며, 퀄컴은 내년 출시될 스냅드래곤 8 엘리트 Gen 6 칩을 위해 빠르게 N2P 공정으로 전환할 계획이다. 업계 전문가들은 이 리소그래피 기반 웨이퍼 한 장당 약 3만 달러에 달할 것으로 보고 있으며, 이는 스마트폰과 태블릿 같은 소비자 전자기기의 가격 상승으로 이어질 수 있다고 분석했다. 관련 기사에 따르면, TSMC는 차세대 칩 생산을 위한 계획을 진행 중이며, 2nm 공정은 내년 애리조나 공장에서도 생산될 예정이고, 1.4nm(A14) 공정은 2028년 대만에서 양산될 예정이다. 결국 고객사들은 이러한 가격 정책에 따를 수밖에 없지만, 표면적으로 보면 2nm과 3nm의 가격 차이는 크지 않다. 그러나 자세히 들여다보면 이야기가 달라진다. Investor의 보도에 따르면 TSMC는 현재 세대의 리소그래피 가격을 인상할 계획이며, 이에 따라 2nm과 3nm의 차이가 10~20% 수준으로 보이는 것뿐이라고 한다. 현재 N3E 노드는 약 2만 5,000달러, N3P 노드는 약 2만 7,000달러로 책정될 것으로 예상되어, 구세대 공정을 이용해 칩을 생산하려는 기업들에게도 재정적 부담이 가중될 전망이다. 앞서 퀄컴과 미디어텍은 각각 스냅드래곤 8 엘리트 Gen 5와 Dimensity 9500을 생산할 때 3nm N3P 공정으로 전환하면서 최대 24%의 추가 비용을 부담한 것으로 알려졌다. 이는 이번 보도 이전에 이미 가격 인상의 영향을 받았음을 시사한다. 결과적으로 이번 조정으로 인해 3nm에서 2nm로의 전환은 예상보다 덜 부담스러워 보일 수 있지만, 웨이퍼당 3만 달러라는 금액이 결코 가벼운 수준은 아니다. 출처 : https://wccftech.com/tsmc-2nm-wafers-to-be-10-to-20-percent-more-expensive-than-3nm/
2025.10.08
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[반도체] TSMC, 2nm 공정 내년 미국 진출… 1.4nm(A14) 공정은 2028년 대만서 가동 예정
TSMC는 빠르게 ‘옹스트롬(Angstrom) 시대’로 진입하고 있으며, 새로운 보고서에 따르면 차세대 A16 및 A14 공정 준비가 이미 대만에서 진행 중이라고 한다. TSMC, 옹스트롬 시대 진입 가속화… 미국 내 생산 확대와 함께 경쟁력 강화 노려 이 대만 반도체 거인은 경쟁사들을 압도하는 생산 주기를 유지하고 있으며, 지정학적 리스크에도 불구하고 빠른 발전을 이어가고 있다. 대만 경제일보(Ctee)의 새로운 보고서에 따르면, TSMC는 반도체 생산 가속화를 위한 계획을 본격적으로 추진 중이며, 회사의 주요 생산 거점 중 하나인 Fab 22가 현재 A14 공정 생산을 위한 준비에 들어갔다. 특히 미국 애리조나 공장에서도 생산 일정이 대폭 앞당겨져, 당초 계획보다 거의 1년 빠른 내년 중 2nm 공정이 도입될 것으로 알려졌다. 먼저 대만 상황을 살펴보면, TSMC의 가오슝(Kaohsiung) 공장은 현재 총 6개의 팹(fab) 건설이 진행 중이다. 이 중 5개는 2nm 및 A16(1.6nm) 대량 생산용으로, 나머지 1개는 고급형 A14(1.4nm) 노드 전용으로 알려졌다. A14 공정은 2028년 양산(HVM, High Volume Manufacturing)에 들어갈 예정이라고 한다. 이 가오슝 단지는 NT$1.5조(약 500억 달러) 이상이 투입된 TSMC 최대 규모의 투자 중 하나로, A16과 A14 공정 도입을 통해 본격적인 옹스트롬 시대를 주도할 것으로 기대된다. 보고서에 따르면 TSMC는 향후 2nm(N2) 및 A16(1.6nm) 공정을 도입하고, Fab 3·4 건설도 추진할 계획이라고 한다. 구체적으로 2nm 공정은 2026년 하반기(H2) 부터 생산이 시작될 것으로 예상된다. 다만 보고서는 애리조나에서 생산 능력을 확대하는 과정이 쉽지 않을 것이라고 지적한다. 이는 배관 및 전기 시스템 공사(plumbing and electrical system construction) 등 여러 기반 시설 문제가 아직 해결되지 않았기 때문이다. 그럼에도 불구하고 미국 정부(USG)가 TSMC에 대해 대만과 미국을 동등하게 대우하도록 압박하고 있는 만큼, 전체적인 진척 속도는 계속 빠르게 유지될 것으로 전망된다. 한편 TSMC와 경쟁사들을 비교해 보면, 경쟁 구도는 사실상 TSMC 쪽으로 기울어져 있는 상황이다. Intel Foundry Services(IFS)가 혁신적인 공정을 개발하지 않는 이상, 경쟁은 일방적일 가능성이 높다. 현재 인텔의 14A(1.4nm) 노드는 TSMC의 A14 공정과 같은 2028년 양산(HVM)에 들어갈 예정이어서, 기술적으로 보면 두 회사가 같은 세대의 노드 수준에서 맞붙게 될 것으로 보인다. 출처 : https://wccftech.com/tsmc-plans-for-next-gen-chip-production-surfaces-up/
2025.10.07
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[반도체] 인텔, AMD와 반도체 위탁생산 계약 협상 중인 것으로 알려져
인텔을 둘러싼 최근 소문이 그 어느 때보다 무성합니다. Semafor에 따르면, 인텔이 한때 PC와 서버 칩 시장에서 가장 큰 경쟁자였던 AMD와 인텔의 생산라인을 이용한 칩 제조에 대해 초기 논의를 진행 중이라고 합니다. TrendForce가 인용한 CNBC 보고서에 따르면, AMD가 인텔을 칩 생산에 활용한다면 이는 인텔의 파운드리 사업에 큰 승리가 될 것이라고 합니다. 이 보고서는 이러한 거래가 상징적인 의미를 가질 것이라고 제안합니다: PC와 서버용 x86 칩 시장에서 치열한 경쟁자인 AMD가 제조를 가장 큰 라이벌에게 맡기는 것이기 때문입니다. 현재 AMD는 대부분의 칩 생산을 TSMC에 크게 의존하고 있습니다. 보고서는 AMD가 인텔과 얼마나 많은 제조를 할지 언급하지 않았지만, 로이터는 3월에 NVIDIA와 Broadcom이 인텔의 가장 진보된 노드인 18A를 테스트하고 있으며, AMD는 이 기술이 자사의 요구에 맞는지 검토 중이라고 보도했습니다. 인텔이 노리는 회사는 AMD뿐만이 아닙니다. 9월 말 인텔이 애플에 접근해 잠재적 투자와 더 긴밀한 협력 방안을 모색하고 있다고 보도했습니다. 이 논의는 초기 단계로 묘사되며 거래로 이어지지 않을 수도 있습니다. 한편, 월스트리트 저널은 인텔이 파운드리 경쟁자이자 제조 파트너인 TSMC에도 연락해 잠재적 투자나 생산 파트너십에 대해 논의했다고 보도했습니다. 그러나 Focus Taiwan에 따르면 TSMC는 어려움을 겪고 있는 칩메이커가 TSMC의 도움을 구하고 있다는 소문에도 불구하고, 투자나 파트너십에 대한 논의가 없었다고 명확히 했습니다. 출처:https://www.techpowerup.com/341561/intel-allegedly-in-talks-with-amd-for-potential-foundry-manufacturing-deal
2025.10.03
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[전자부품] 삼성, 2nm 공정 웨이퍼 가격 대폭 인하… TSMC 가격보다 3분의 1 저
전 세계적으로 최첨단 반도체 생산 능력이 이미 한계에 도달해 있어, 엔비디아 같은 첨단 기술 기업들이 원하는 만큼 공급을 확보하지 못하고 있다. 이처럼 공급자가 우위에 선 시장임에도 불구하고, 파운드리 간에는 여전히 일정 수준의 경쟁이 존재한다. 디지타임즈 보도에 따르면 삼성전자는 2nm(SF2, 또는 SF3P) 웨이퍼 가격을 2만 달러로 낮추며, 시장 선두 TSMC의 3만 달러 수준보다 무려 3분의 1가량 저렴하게 책정한 것으로 전해졌다. 이 같은 행보는 삼성 입장에서 공격적이지만, 2nm 생산 라인의 가동률을 유지하고 투자 대비 수익을 확보하기 위해 불가피한 선택으로 보인다. 실제로 삼성은 지난 1월 파운드리 투자액을 절반으로 줄였다는 보도가 나왔는데, 이는 정반대로 투자를 확대하고 있는 TSMC와 대조된다. 여기에 더해 신규 텍사스 반도체 공장도 고객사 확보 부족으로 가동이 지연되고 있다. 하지만 전망이 암울하기만 한 것은 아니다. 삼성은 최근 테슬라와 165억 달러(약 22조 원) 규모의 계약을 따내, 전기차 업체의 AI6 칩을 생산하기로 했다. 특히 이 칩은 앞서 언급한 텍사스 공장에서 제조될 예정이어서, 삼성의 미국 파운드리 전략에도 큰 활력을 줄 것으로 기대된다. 테슬라의 까다로운 요구 사항과 협력은 삼성의 수율 개선(목표 60~70%)에도 도움을 줄 것으로 보여, 고급 파운드리 시장에서 입지를 강화하는 계기가 될 수 있다. 디지타임즈는 또한 삼성 파운드리가 과거부터 가격 경쟁을 무기로 삼아왔다는 점을 짚었다. 현재와 미래의 TSMC 공장들이 이미 풀가동 상태이고 이에 걸맞은 프리미엄 가격을 요구하는 상황에서, 삼성의 2만 달러 웨이퍼 가격은 TSMC 가격을 감당하기 어려운 고객사들에게 매력적인 대안이 될 수 있다. 그럼에도 TSMC는 크게 우려하지 않는 분위기다. 2nm 시장에서 이미 압도적인 점유율을 차지하고 있으며, 인텔·AMD·미디어텍은 물론 오랜 파트너인 엔비디아까지 포함해 대형 고객사 15곳과 2nm 생산 계약을 체결한 것으로 전해졌기 때문이다. https://www.tomshardware.com/tech-industry/samsung-takes-a-scalpel-to-its-2nm-wafer-price-tag-bringing-it-down-to-usd20-000-korean-chipmaker-now-undercuts-rival-tsmc-by-33-percent
2025.09.29
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[전자부품] TSMC, A14 공정 순항… 수율 기대치 상회·N2 대비 15% 성능 향상
9월 25일 소식에 따르면, TSMC가 1.4nm A14 공정의 진행 상황을 공개했다. 회사 측은 이번 공정이 예상보다 높은 수율을 기록했으며, N2 대비 성능은 15% 향상되고 전력 소모는 30% 감소했으며, 칩 밀도는 20% 증가했다고 밝혔다. A14 공정은 2세대 GAAFET 나노시트 트랜지스터와 NanoFlex Pro 아키텍처를 채택했으며, 2028년 양산이 예정돼 있다. 애플, 엔비디아, AMD가 이미 해당 공정을 도입하기로 확정한 것으로 알려졌다. 퀵테크놀로지 9월 25일 보도에 따르면, 최근 TSMC가 차세대 A14(1.4nm) 공정의 최신 진행 상황을 공개했다. 회사 측은 A14 공정이 순조롭게 진행되고 있으며, 수율(良率) 또한 예상보다 양호하다고 밝혔다. 수율 외에도 A14 공정은 성능과 전력 효율 면에서 N2 공정 대비 두드러진 향상을 보였다. 구체적으로 A14는 N2보다 성능이 15% 빠르며, 전력 소모는 30% 감소했다. TSMC는 A14 공정에 2세대 GAAFET 나노시트 트랜지스터와 새로운 NanoFlex Pro 표준 셀 아키텍처를 적용할 계획이다. 이러한 기술 도입으로 칩 밀도는 N2 공정 대비 최대 20% 향상될 전망이다. 이는 동일한 칩 면적에 더 많은 트랜지스터를 집적할 수 있음을 의미하며, 그 결과 더 높은 연산 성능과 더 낮은 전력 소모를 실현할 수 있다. 현재 TSMC는 A14 공정이 2028년에 양산 단계에 들어설 것으로 예상하고 있으며, 애플·엔비디아·AMD 등 주요 고객사들이 이 신공정을 채택할 계획이다. A14는 향후 수년간 소비자 전자 제품의 성능 향상을 견인하는 핵심 동력이 될 것으로 전망된다. https://news.mydrivers.com/1/1076/1076788.htm
2025.09.25
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[이슈/논란] 한국 GDP 대만에 따라잡힌다고 하네요.
반도체 수출의 힘이 대단합니다. 소득격차도 벌어질거라고 예상하고 있다고 합니다.
2025.09.14
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[과학] 국내 스타트업 퓨리오사AI, AI 반도체 대회서 엔비디아 제쳤다
국내 기반 반도체 스타트업 퓨리오사AI가 세계적인 인공지능(AI) 반도체 성능 경연대회에서 '전통 강호' 미국 엔비디아를 제쳤다. 23일 퓨리오사AI는 첫번째 반도체 시제품인 ‘워보이’가 글로벌 AI반도체 대회 ‘MLPerf(엠엘퍼프)’ 추론분야에서 엔비디아의 ‘T4’를 넘어서는 성능 지표를 인정받았다고 밝혔다. 엠엘퍼프는 매년 열리는 AI반도체 벤치마크 대회다. 구글·마이크로소프트·삼성전자·인텔·퀄컴을 비롯한 글로벌 기업과 스탠퍼드·하버드 등 대학이 모여 설립한 비영리단체 ML커먼스가 주최한다. 퓨리오사AI는 2019년 아시아권 스타트업으로는 처음으로 엠엘퍼프에 등재됐다. 올해는 엠엘퍼프 추론 분야에서 자체 실리콘칩으로 결과를 제출한 유일한 스타트업 기록을 냈다. 퓨리오사AI의 워보이는 고성능 컴퓨터 비전(시각 인식) 활용에 적합하게 설계한 반도체다. 사진과 영상 데이터를 빠르게 분석해 원하는 것을 찾고 분류하는 데에 높은 성능을 보인다. AI모델 300여개를 지원한다. 이번 엠엘퍼프 결과에 따르면 워보이는 엔비디아의 T4에 비해 이미지분류, 객체검출 처리속도 등에서 약 1.5배 가량 더 뛰어난 성능을 나타냈다. T4가 워보이의 2.5~3배 가격인 것을 감안하면 가격 대비 성능이 매우 우수하다는 설명이다. 워보이는 가격이 열 배 이상, 트랜지스터 개수도 열 배 이상 많은 엔비디아의 최신 플래그십 제품 A100의 단일 인스턴스와는 대등한 수준의 성능을 기록했다. 퓨리오사AI는 "글로벌 IT기업들이 조 단위 규모를 투자하는 AI반도체 분야에서 스타트업이 경쟁력 있는 결과를 제출한 것은 이례적"이라며 "워보이는 폭발적으로 계산량이 증가하는 데이터센터와 고성능 엣지 영역 등에서 효율적인 솔루션으로 자리매김할 것으로 기대한다"고 밝혔다. 서울대 석좌교수이자 반도체공학회 전임회장인 정덕균 교수는 "퓨리오사AI가 대한민국 시스템 반도체 역사에서 획기적인 이정표를 세웠다”고 평가했다. 퓨리오사AI는 2017년 출범해 올해로 업력 5년차다. 지난 4년간 고성능 AI반도체 개발에 필요한 하드웨어부터 소프트웨어까지 ‘풀스택’을 직접 개발해 왔다. 삼성전자, 애플, 퀄컴, AMD, 구글, 아마존 등에서 전문성을 쌓은 인재 70여 명으로 구성됐다. 그간 네이버 D2SF, DSC인베스트먼트, 산업은행 등으로부터 800억원 규모 투자를 유치했다. AI 반도체 업계 최대 규모다. https://www.hankyung.com/article/202109230502i
2025.08.26
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[취재현장] [특집] TSMC, CoPoS 패키징 전략 진단
핵심 메시지 : TSMC는 기존 CoWoS(Co-Chip-on-Wafer-on-Substrate) 고급 패키징 플랫폼에 더해, 새로운 통합형 패키징 기술인 CoPoS(Chip-on-Panel‑on‑Substrate)를 개발 중이다. CoPoS는 2026년 도입 예정인 InFO‑PoP 기반 wafer-level multi-chip 모듈(통합형)을 뛰어넘는 차세대 기술로, 칩과 패널 및 기판이 하나로 결합된 구조다. TSMC는 기술을 내재화하기 위해 2028년에 대비해 Chiayi 지역 및 미국 파운드리(제조 시설) 중심의 공급망을 준비하고 있다. SoIC·CoPoS 설비가 북미에 증설되면 미·대만 이원화로 지정학 리스크를 희석. 북미 OSAT·기판·케미컬 밸류체인 구축에 이점을 가져갈 수 있다. 단, 전략의 성공 여부는 대면적 RDL 정밀도와 워페이지 억제 같은 제조 수율의 빠른 수렴, 그리고 미국 내 패키징 현지화 실행력에 달려 있다. 본지는 TSMC의 변화를 전체 시장 관점에서 진단. 다음과 같이 공개한다. [특집] TSMC, CoPoS 패키징 전략 긴급진단 세계 최대 파운드리 기업 TSMC가 고대역폭 메모리(HBM)와 대규모 칩렛을 결합한 첨단 패키징 수요 급증에 대응하기 위해 새로운 패널 레벨 패키징 기술 CoPoS(Chip-on-Panel-on-Substrate) 도입에 나선다. 기존 CoWoS(Co-WoS) 생산 능력 한계를 보완하고, AI·HPC 반도체 공급망의 핵심 병목을 풀기 위한 중장기 전략의 일환이다. 1. AI·HPC 수요 폭증과 CoWoS 병목 지난 3~4년간 AI 트레이닝 및 추론용 GPU, 고대역폭 메모리(HBM)를 통합한 HPC 프로세서 수요는 기하급수적으로 증가했다. NVIDIA, AMD, Broadcom과 같은 주요 팹리스 고객사가 HBM 통합 패키징을 요구하면서 TSMC CoWoS는 세계 시장 점유율 약 70%로 독점적 지위를 확보했지만, 대형 인터포저와 고대역폭 메모리(HBM)를 결합하는 공정 특성상 생산 비용과 리드타임이 길다. 일부 고객은 패키징 리드타임이 6개월 이상 지연되고, 공급량 부족으로 차세대 칩 출시 일정이 밀리는 사태가 벌어졌다. 특히 CoWoS는 웨이퍼 단위에서만 동작하는 구조적 한계가 있어 패키징 면적 확장과 생산량 증대에 한계가 있다. AI와 HPC 시장이 단일 대역 제품이 아니라 다양한 I/O 구성과 다중 칩렛 구조로 진화하는 상황에서, 기존 CoWoS만으로는 시장 수요를 감당하기 어렵다는 진단이 TSMC 내부에서 내려졌다. 이에 따라 저원가·대량생산형 패키징 솔루션의 필요성이 커졌고, TSMC가 CoPoS를 차기 카드로 꺼낸 것이다. 2. CoPoS의 기술적 특징과 구현 요건 CoPoS(Chip-on-Panel-on-Substrate)는 대면적 패널(약 310mm x 310mm) 위에서 팬아웃 재배선RDL(Redistribution Layer)과 칩 집적을 수행한 뒤, 기판(Substrate)에 실장하는 패널 레벨 패키징 방식이다. CoWoS의 실리콘 인터포저 웨이퍼 직경 제약(300mm)을 폴리머 기반 패널 면적으로 전환해 면적 효율과 랏당 출력량을 키우는 접근 방식이 특징이다. 대형 칩렛과 HBM 스택을 하나의 패키지에 실장하면서도, 제조 공정 단가를 크게 낮출 수 있다. 실리콘 인터포저보다 전기적 특성에서 불리할 수 있지만, AI/HPC 워크로드에 최적화된 신호·전력 무결성 설계와 고밀도 RDL(Redistribution Layer) 기술을 적용해 보완하면 된다. 작업은 패널 성형(몰딩) → 다이 배치 → RDL 형성(저 L/S) → 열·기계 안정화(워페이지 제어) → 언더필/실장 → 기판 접합. 순으로 이 이뤄진다. 단, 기술을 안정적으로 구현하기 위해서는 다음 핵심을 갖춰야 한다. ① 패널 워페이지 제어: 대형 기판에서 발생하는 미세 뒤틀림을 제어하는 정밀 열·기계 처리 ② 다이 시프트 보정: 패널 상의 칩 위치 오차를 나노미터 수준에서 교정 ③ 고정밀 RDL 제작: 초미세 배선 패턴을 균일하게 인쇄하는 광학·포토 공정 기술 ④ 열·전기 신뢰성 확보: HBM 결합 제품과 비교해도 장기 신뢰성을 유지하는 열관리 설계 패널 크기 확대로 인한 워페이지(뒤틀림) 제어, 다이 시프트 보정, 나노 단위의 RDL 제작 정밀도, 장기 열·전기 신뢰성 확보가 관건이다. 특히 HBM을 포함한 고대역폭 설계의 경우 패널 공정에서 균일성을 유지하는 것이 어려워, CoWoS와 CoPoS의 제품 포트폴리오 분리가 불가피하다. 3. 전략 전환의 배경과 필요성 TSMC가 CoPoS로 눈을 돌린 핵심 이유는 생산 확장성과 비용 경쟁력이다. 재차 강조하지만 CoPoS는 대형 리소그래피 장비 대신 패널레벨 공정과 결합할 수 있어 생산 효율성이 높다. 이는 기존 CoWoS 대비 생산 면적당 처리량을 높이고, 대량 생산 시 가격 경쟁력을 확보할 수 있는 핵심 요소다. 기술적으로는 패널 워페이지(뒤틀림) 제어, 다이 시프트 오차 보정, 고정밀 RDL 제작 등 난제가 남아 있지만, CoWoS 대비 최대 15~30%의 원가 절감이 가능하다는 평가가 있다. 또한 HBM을 다층 적층하는 고사양 GPU 패키징은 CoWoS에 남기고, HBM 의존도가 낮은 DPU·네트워크 칩·엣지 AI 프로세서는 CoPoS로 이관하는 이원화 전략을 취함으로써, 공정 병목을 해소하고 고객 맞춤형 공급 체계를 구축할 수 있다. 시장 측면에서 NVIDIA, AMD, 브로드컴 등 주요 HPC·네트워킹 고객은 HBM이 필수적인 제품은 CoWoS를, 그렇지 않은 제품은 CoPoS로 이원화해 공급 안정성을 확보할 가능성이 크다. 애플과 같은 모바일·엣지 고객 역시 AR/VR, 엣지 AI 칩 등에 패널 레벨 패키징을 적용할 수 있다. 4. 업계의 시각과 브랜드별 전략 CoWoS는 최고 성능 구현에 유리하지만, 공급량이 제한적이고 가격이 높다. 반면 CoPoS는 약간의 성능 절충을 감수하더라도 더 많은 제품을 빠른 시간에 공급할 수 있다. TSMC는 CoWoS를 프리미엄 제품군에 집중하고, CoPoS를 중·고급형 AI/HPC 시장에 투입해 포트폴리오를 양분하는 전략을 구사할 것으로 보인다. 구분 주요 패키징 기술 적용 제품군 강점 시장 점유율(첨단 패키징 기준, 2024~2025E) 전략 방향 TSMC CoWoS, InFO, SoIC, CoPoS(개발 중) AI/HPC GPU, CPU, ASIC, 네트워크 칩 HBM 통합 최적화, 고밀도 인터포저, 고성능 신호 무결성 약 70% CoWoS는 HBM 고성능 제품군 전용, CoPoS로 대량·저원가 패키징 시장 확대 삼성전자 I-Cube, H-Cube, PLP(패널레벨패키징) AI/HPC GPU, 네트워크 칩, 모바일 AP 패널레벨 대량 생산 경험, HBM 직접 생산 능력 약 15% HBM+패키징 수직 통합 경쟁력, PLP로 CoPoS 시장 조기 진입 인텔 EMIB, Foveros, Foveros Direct CPU, GPU, AI 가속기, FPGA 이기종 집적, 고대역폭 인터커넥트, 적층 기술 약 7% 대형 클라이언트·서버 CPU 중심, AI 칩렛 구조 확장 ASE FOCoS, 2.5D/3D 패키징, 패널레벨 FO 네트워크 칩, 모바일 AP, ASIC OSAT 최대 생산능력, 다양한 고객 포트폴리오 약 5% TSMC·삼성 외 고객사 확보, 패널 생산라인 투자 확대 동종 업계는 TSMC의 CoPoS 전환을 패키징 산업의 대세 전환 신호로 분석했다. NVIDIA: 초고대역 HBM 인터포저 필요 SKU는 CoWoS 유지. 일부 HBM 가볍거나 I/O 중심의 가속기·DPU·NIC를 CoPoS로 분리 가능. 캘린더 베이스로 출하 분산과 BOM 최적화를 노릴 만함. AMD/브로드컴/마벨: 네트워킹 스위치·DPU·스토리지 컨트롤러 등 HBM 비의존형 고대역 칩렛은 CoPoS 후보. Zen/MI 계열 일부 SKU도 원가 포지셔닝 따라 분화 가능. 애플·모바일/엣지 고객: InFO·SoIC 라인과 역할 분담. 엣지 AI·AR/VR·베이스밴드의 패키지 대면적화 수요에 패널 레벨이 맞물릴 여지. 경쟁사 대응도 빨라지고 있다. 삼성전자는 이미 PLP(Panel Level Packaging) 경험과 HBM 수직 통합 능력을 갖추고 있어 CoPoS 대응 전략에서 유리한 고지를 점할 수 있다. 인텔은 EMIB와 Foveros Direct를 결합한 하이브리드 패키징을 고도화하며 차별화를 꾀하고 있다. OSAT 업계(ASE, Amkor 등)는 TSMC·삼성과 협력 또는 틈새형 CoPoS 공정 개발을 통해 새로운 수요를 흡수하려 한다. 5. 시장 전망 및 로드맵 TSMC는 2026년 대만 Chiayi AP7에서 CoPoS 파일럿 라인을 가동하고, 2028년에는 미국 현지에서 SoIC·CoPoS 첨단 패키징 시설을 착공할 계획이다. 오는 2029년까지는 대량 양산 체제를 구축해 CoWoS와 병행 생산이 논의되고 있다. 따라서 CoPoS가 성공적으로 안착하면, 패키징은 더 이상 공급 병목이 아닌 제품 다변화와 시장 확대의 촉매제가 될 수 있다. 그러나 초기 수율 안정화, 고객사 설계 전환 속도, 경쟁사의 PLP 가격 공세, 미국·대만 양산 거점 구축 속도 등이 결정적인 변수다. TSMC는 CoPoS를 통해 패키징 패러다임 전환을 예고하지만, 성공 여부는 기술과 공급망, 시장 전략을 얼마나 정밀하게 조율하느냐에 달려 있다. 업계는 2026년 파일럿 라인 가동 이후 2028~2029년 대규모 양산 전환 시점을 예의주시하고 있다. ◆ 연도별 시나리오 TSMC가 추진 중인 CoPoS는 2026년 전후로 시범 생산에서 대규모 양산으로 전환할 가능성이 높다. 이는 단순한 신규 패키징 옵션을 넘어, AI·HPC·네트워크 칩 시장 전반에 구조적 변화를 가져올 수 있는 전환점이 될 것으로 전망된다. ① 2026년 = 양산 초기, 고객사 파일럿 프로젝트 2026년 상반기에는 CoPoS가 NVIDIA, AMD, Broadcom 등 일부 주요 고객사의 중간급 AI 가속기와 네트워크 스위치 칩에 시범 적용될 가능성이 크다. CoWoS 대비 15~25% 낮은 원가 구조를 기반으로, 대규모 클라우드 데이터센터 프로젝트에 빠르게 채택될 수 있다. 그러나 초기 수율과 신뢰성 확보가 관건이며, 업계는 TSMC의 패널 레벨 생산라인 안정화 여부를 면밀히 관찰할 것으로 예상된다. ② 2027년 = 대량 공급과 세그먼트 세분화 2027년에는 CoPoS의 양산 라인이 안정화되면서 성능 대비 가격 비율(P/P)이 명확해질 전망이다. CoWoS는 여전히 플래그십 AI 칩과 HBM4 이상 제품에 집중되지만, CoPoS는 HBM3E·HBM4 초기 제품과 결합해 중고급형 시장을 장악할 가능성이 높다. TSMC는 패키징 포트폴리오 2중화 전략을 본격 가동하며, 고객사별 맞춤형 패키징 옵션을 제공할 수 있다. 이는 공급망 유연성을 높이고, AI 반도체 가격 안정화에 기여할 것으로 보인다. ③ 2028년 = 경쟁구도 본격화 2028년이 되면 삼성전자, 인텔, ASE 등 주요 경쟁사도 CoPoS 유사 기술을 상용화하며 시장 점유율 경쟁이 치열해질 전망이다. 삼성전자는 PLP 기반 CoPoS형 패키징을 HBM 생산과 결합해 단가를 추가로 절감하고, 인텔은 EMIB·Foveros와 결합한 하이브리드 CoPoS로 차별화를 시도할 수 있다. 하지만 TSMC는 동 시기에 CoPoS의 제2세대 버전을 발표해 폴리머 기판의 전기적 성능 개선과 더 미세한 피치 범프 실장 기술을 적용할 가능성이 높다. 이는 HPC뿐 아니라 AI PC, 자율주행 SoC 등 새로운 응용 시장으로 확장을 알리는 분수령이 될 전망이다. [ 커뮤니티 빌런 18+ 독점 콘텐츠로 무단전재 및 재배포 Ai 학습을 금지합니다 ] #TSMC #기술 #리소그라피 #반도체 #삼성전자 #웨이퍼 #인텔 #패키징 #copos #대만
2025.08.15
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[금융/경제] 인텔 CEO 립부 탄, 경력 논란 해명 이어 트럼프 대통령과 회동 “미국 기술 리더십 강화 협력”
인텔 코퍼레이션 최고경영자(CEO) 립부 탄이 최근 불거진 경력 관련 의혹에 대해 직접 입장을 밝힌 지 하루 만에, 도널드 트럼프 미국 대통령과 만나 향후 협력 방안을 논의했다. 탄 CEO는 11일(현지시간) 성명을 통해 “미국에서 40년 이상 생활하며 받은 기회에 감사하며, 인텔을 이끄는 역할은 기술·제조 역량 강화와 국가 안보, 경제력 증진에 직결된다”고 강조했다. 그는 월든인터내셔널과 케이던스 디자인 시스템즈 재직 경력과 관련된 의혹에 대해 “전 세계 반도체 산업에서 40여 년간 법과 윤리를 준수해왔다”며, 신뢰와 원칙을 기반으로 한 평판이 현재 경영에도 이어지고 있다고 해명했다. 이어 그는 미국 행정부와 협의 중이며, 이사회가 회사의 변혁·혁신과 규율 있는 실행을 지지하고 있다고 밝혔다. 특히 올해 말 미국 내 첨단 반도체 공정을 활용한 대량 생산이 시작될 예정이라며, 이를 “미국 기술 생태계의 중요한 이정표”라고 평가했다. 이후 하루가 지난 12일, 인텔은 트럼프 대통령과의 회동 결과를 발표했다. 인텔 측은 공식 성명에서 “탄 CEO가 트럼프 대통령과 만나 미국의 기술 및 제조 리더십 강화를 위한 candid(허심탄회)하고 건설적인 논의를 나눴다”며, “대통령의 강력한 리더십에 감사하며, 위대한 미국 기업의 복원을 위해 행정부와 긴밀히 협력할 것”이라고 밝혔다. 이번 회동은 인텔이 미국 내 생산과 기술 투자를 확대하겠다는 의지를 재확인하는 계기가 됐다는 평가가 나온다. 업계 관계자들은 탄 CEO의 연이은 메시지가 회사 안팎의 신뢰 회복과 미국 반도체 산업 경쟁력 강화 전략을 동시에 겨냥한 것으로 보고 있다.
2025.08.13
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[반도체] TSMC, 미국 반도체 관세 면제 소식에 주가 급등
대만의 대표 반도체 기업 TSMC가 미국의 반도체 관세 면제 대상에 포함될 것이라는 기대감 속에 주가가 급등하며 사상 최고치를 경신했다. Bloomberg에 따르면 대만 국가발전위원회(NDC)의 류징칭 주임위원은 이날 입법원 청문회에서 “TSMC는 미국 내에 반도체 생산 공장을 운영하고 있기 때문에, 미국이 예고한 100% 관세 부과 대상에서 제외된다”고 공식 발표했다. 이 소식이 전해진 직후, TSMC의 주가는 4.89% 상승해 NT$1,180을 기록하며 역대 최고가를 경신했다. 투자자들은 미국의 보호무역 강화 움직임 속에서도 TSMC가 안정적인 글로벌 공급망을 유지할 수 있을 것으로 보고 있다. 미국은 최근 대만산 제품에 대해 20%의 관세를 부과했지만, 반도체 부문은 별도 취급하고 있으며, TSMC는 애리조나에 총 165억 달러 규모의 반도체 생산 시설을 건설 중이다. 이는 미국 역사상 최대 규모의 외국인 직접투자 중 하나로 평가된다. 대만 정부는 이번 관세 면제 조치가 자국 경제에 긍정적인 영향을 미칠 것으로 보고 있으며, 2025년 경제성장률 전망치를 3.1%로 유지했다. 또한, 대만의 기술 수출은 올해 2분기에 7.96% 증가하며 최근 4년간 가장 높은 성장률을 기록했다. TSMC는 AI용 첨단 반도체 생산을 확대하고 있으며, 미국과의 협력을 통해 글로벌 반도체 시장에서의 입지를 더욱 강화할 것으로 기대된다. 출처 : 블룸버그 (Bloomberg) 해외에 소개된 오늘자 기사 중 재미난 게 있어 가져와 봤습니다. 이래저래 말은 많아도 TSMC가 대단하긴 하네요.
2025.08.07
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